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12代酷睿對(duì)比11代酷睿 11處理器和12處理器有什么區(qū)別

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上一篇文章我們講了12代酷睿的異構(gòu)設(shè)計(jì)到底是一場(chǎng)怎樣的革命 ， 那么除了處理器本身的架構(gòu)設(shè)計(jì)之外 ， 12代酷睿還有哪些點(diǎn)得以讓官方自己以“一戰(zhàn)封神”來(lái)宣傳自己的12代酷睿系列處理器呢？這篇文章筆者打算仔細(xì)梳理一下12代酷睿系列相比上一代處理器在與外圍設(shè)備的連接性方面的進(jìn)步 ， 也就是大家隨著這次12代酷睿發(fā)布開(kāi)始常常聽(tīng)到的兩個(gè)關(guān)鍵詞——DDR5和PCIE 5.0 。

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之所以說(shuō)處理器與外圍設(shè)備的連接性也很重要是因?yàn)樘幚砥魇切枰诺揭粋€(gè)完整的系統(tǒng)中才能發(fā)揮其能力的 ， 如果只是一顆單獨(dú)的處理器給你的話它并沒(méi)有任何用處 ， 而對(duì)于系統(tǒng)來(lái)說(shuō) ， 整個(gè)系統(tǒng)最終的體驗(yàn)往往取決于“木桶效應(yīng)” ， 也就是最慢的那一方面 ， 所以為了全面提升新一代處理器平臺(tái)的用戶體驗(yàn) ， 這次12代酷睿英特爾還同時(shí)讓其支持DDR5內(nèi)存和PCI-E 5.0 。
先定個(gè)基調(diào) ， 這次12代酷睿支持DDR5內(nèi)存和PCI-E 5.0其實(shí)是非常超前的舉動(dòng) ， 如果不是英特爾如今的這番決定 ， 正常來(lái)說(shuō)我們享受到DDR5內(nèi)存和PCI-E 5.0還要往后延期個(gè)好幾年 。
英特爾消費(fèi)級(jí)第一代支持PCI-E 3.0的處理器是Ivy Bridge ， 已經(jīng)是2012年的事兒 ， 之后是今年年初的Rocket Lake開(kāi)始支持PCI-E 4.0 ， 然后也就半年時(shí)間 ， 12代酷睿就開(kāi)始支持PCI-E 5.0了 ， 不得不說(shuō)這與兩年前被AMD搶了PCI-E 4.0的首發(fā)有巨大的關(guān)系 ， 不然理論上來(lái)說(shuō) ， 對(duì)于消費(fèi)級(jí)市場(chǎng)PCI-E 4.0再用幾年絕對(duì)是足夠的 ， 所以這方面12代酷睿真的是拉著我們飛奔似的向未來(lái)奔赴 。
DDR5內(nèi)存的支持相對(duì)顯得自然一點(diǎn) ， 目前DDR4內(nèi)存也已經(jīng)用了有些年頭了 ， 并且許多出廠預(yù)超頻的高頻DDR4內(nèi)存也已經(jīng)超過(guò)DDR5標(biāo)準(zhǔn)的及格線 ， 進(jìn)步到DDR5時(shí)代也是順理成章 ， 而首先將DDR5內(nèi)存帶到消費(fèi)級(jí)市場(chǎng)的就是這次的12代酷睿 ， 與DDR5同時(shí)推出的 ， 還有XMP 3.0 。
PCI-E 5.0：對(duì)比11代酷睿提升100%12代酷睿首次把PCI-E 5.0引入消費(fèi)市場(chǎng) ， 與之前的PCI-E 4.0相比 ， PCI-E 5.0依然采用同樣的128b/130b編碼方式、目標(biāo)比特誤碼率（BER）、信令和加擾方案等 ， 但更改了EIEOS和數(shù)據(jù)比特率定義等 。此外 ， 還有其他的設(shè)計(jì)更改 ， 比如二階響應(yīng)的時(shí)鐘數(shù)據(jù)恢復(fù)（CDR）和CEM連接器 。
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PCI-E 5.0帶來(lái)了更高傳輸速度 ， x16帶寬（雙向）從PCI-E 4.0的64 GB/s提升到了128 GB/s ， 提高了設(shè)備傳輸速率的上限 ， 以滿足數(shù)據(jù)中心、高性能計(jì)算、邊緣計(jì)算、機(jī)器學(xué)習(xí)、人工智能和5G網(wǎng)絡(luò)等場(chǎng)景里日益增長(zhǎng)的帶寬需求 ， 也可以讓設(shè)備制造商用更少的通道數(shù)實(shí)現(xiàn)同樣的帶寬 。
【12代酷睿對(duì)比11代酷睿 11處理器和12處理器有什么區(qū)別】在PCI-E 5.0的物理和電氣接口規(guī)范基礎(chǔ)上推出了對(duì)應(yīng)的CXL 2.0規(guī)范 ， 增加了內(nèi)存池的支持 ， 以最大限度地提高內(nèi)存利用率 ， 并且提供了對(duì)持久性內(nèi)存的標(biāo)準(zhǔn)化管理 ， 允許與DDR同時(shí)運(yùn)行 ， 從而可以釋放DDR用于其他用途 ， 同時(shí)向后兼容CXL 1.1和CXL 1.0版規(guī)范 。CXL作為一種開(kāi)放性的互聯(lián)協(xié)議 ， 能夠讓CPU與GPU、FPGA或其他加速器之間實(shí)現(xiàn)高速高效的互聯(lián) ， 滿足現(xiàn)今高性能異構(gòu)計(jì)算的要求 ， 并且提供更高的帶寬及更好的內(nèi)存一致性 。

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