引言
現(xiàn)有的接口技術(shù)如低電壓差分信號(hào)傳輸(LVDS)、更低擺幅差分信號(hào)傳輸(RSDS)及CMADS雖然仍可滿足上一代筆記本計(jì)算機(jī)的要求,在某種程度上節(jié)省用電,減少這類產(chǎn)品的互連線路,并減低其電磁干擾,但對(duì)于正在開(kāi)發(fā)中的新一代蜂窩式移動(dòng)電話及個(gè)人數(shù)字助理,現(xiàn)有的接口技術(shù)便無(wú)法滿足其要求,因?yàn)樾乱淮a(chǎn)品的設(shè)計(jì)要求更低的功率、更少互連線路以及更低的電磁干擾 。移動(dòng)像素鏈路 (MPL) 可為接收及發(fā)送視頻的輸入/輸出端口提供一個(gè)高性能的通信接口,而這種接口具有以下三大優(yōu)點(diǎn):更少的連線(只有兩條活躍線路)、功率低以及電磁干擾極為微弱 。
MPL 鏈路簡(jiǎn)介
為了確保系統(tǒng)操作時(shí)可以充分發(fā)揮低功率及低電磁干擾的優(yōu)點(diǎn),MPL 鏈路技術(shù)利用較低的電流來(lái)傳送信號(hào),而這兩個(gè)邏輯電平的高低取決于接收器傳送給發(fā)送器的電流究竟是強(qiáng)還是弱 。這兩條電流可視為一條電流,在上層流動(dòng)的是交流電電流,在下層流動(dòng)的則是直流偏壓電流,上下層電流的典型值分別為 150mA 及 450mA 。換言之,這兩條電流可分為一條在上層流動(dòng)的交流電電流 ((150mA) 以及另一條在下層流動(dòng)的直流電流(300mA) 。
MPL 的技術(shù)規(guī)格對(duì)高低電流有清楚的界定,高電流(即450mA)屬于邏輯低電平,而低電流(150mA)則屬于邏輯高電平 。電流先由驅(qū)動(dòng)器接收,然后通過(guò)MG(MSSA)管腳傳送回接收器 。MPL接地的四周應(yīng)有一條低阻抗的路徑,而這條路徑應(yīng)回到其起點(diǎn) (即接收器) 。此外,將接地設(shè)于信號(hào)傳送線路的四周有助縮小信號(hào)傳送線路的覆蓋面積,而且由于采用電流模式開(kāi)關(guān),加上電流量較低,以及較小的覆蓋面積,因此產(chǎn)生的電磁干擾也較少 。
MPL 鏈路比其它信號(hào)傳輸標(biāo)準(zhǔn)更優(yōu)勝,例如MPL鏈路傳送的電流比LVDS低(前者為300mA而后者為3.5mA);MPL的20mV電壓擺幅也比 LVDS 的 350mV低 。這兩個(gè)優(yōu)點(diǎn)有助減低功耗及噪音 。鏈路通電時(shí),從屬芯片隨即啟動(dòng),其電流由驅(qū)動(dòng)器拉至適當(dāng)?shù)乃?。這樣可以確保 MPL 鏈路無(wú)論從哪一個(gè)方向傳送信號(hào),信號(hào)都可保持完整無(wú)缺,而且反抗噪音干擾的能力也可獲得進(jìn)一步加強(qiáng) 。
美國(guó)國(guó)家半導(dǎo)體采用 WhisperBus 技術(shù)作為MPL鏈路的物理層 。一直以來(lái),屏幕較大的薄膜晶體管(TFT)液晶顯示器都采用類似 WhisperBus 的技術(shù),而便攜式電子產(chǎn)品也基于同樣的理由采用這種技術(shù) 。MPL鏈路除了保留 WhisperBus 物理層的基本功能之外,還設(shè)有自己的移動(dòng)通信協(xié)議(截至 2004 年有關(guān)協(xié)議仍在制定中),以及另外再添加節(jié)能(睡眠)模式及雙向數(shù)據(jù)傳輸功能 。圖 1 所示的是基本的 MPL 鏈路 。主控器設(shè)于主機(jī)(BBP、微處理器或圖像處理器)之旁,而從屬芯片則緊貼顯示器或目標(biāo)裝置 。
MPL 線路驅(qū)動(dòng)器
MPL 線路驅(qū)動(dòng)器設(shè)有一個(gè)雙狀態(tài)的電流接收器 。電流的大小取決于輸入的狀態(tài) (LVCMOS) 。線路的電壓由 MPL 鏈路上的接收器而非線路驅(qū)動(dòng)器負(fù)責(zé)設(shè)定 。由于線路驅(qū)動(dòng)器可在廣闊的接收電壓范圍內(nèi)操作,因此如有設(shè)計(jì)上的需要,線路驅(qū)動(dòng)器及接收器可以分別由不同的供電干線為其提供電源 。接收器的電源也可關(guān)閉,以便將線路電流調(diào)低至零,以支持極低功率的睡眠模式或 MPL 的關(guān)閉狀態(tài) 。圖 2 所示的是已簡(jiǎn)化的線路驅(qū)動(dòng)器電路圖 。若 DEnable* (內(nèi)部信號(hào)) 處于邏輯低電平 (LOW),Idata 開(kāi)關(guān)便與 MPL 信號(hào)線路連接一起,而驅(qū)動(dòng)器會(huì)接收較強(qiáng)的電流 (Idata) 。若 Din 內(nèi)部信號(hào)處于邏輯低電平 (LOW),2Idata 也會(huì)通過(guò)開(kāi)關(guān)輸入線路,令 3Idata 的電流改由驅(qū)動(dòng)器接收 。若 Din 處于邏輯高電平,2Idata 開(kāi)關(guān)會(huì)斷開(kāi),以便進(jìn)入另一狀態(tài) (Idata) 。若兩個(gè)開(kāi)關(guān)都斷開(kāi) (DEnable* = High),驅(qū)動(dòng)器會(huì)關(guān)閉,驅(qū)動(dòng)器便不會(huì)接收任何電流 。理論上,按照 MPL 標(biāo)準(zhǔn)的規(guī)定,邏輯低電平屬較高電流(3 x Idata),而邏輯高電平則屬較低電流 (1 x Idata) 。進(jìn)行初步測(cè)試時(shí),MPL 測(cè)試芯片(LM2500)的電流(Idata)可設(shè)定在 100(A 至 200mA 的范圍內(nèi) 。驅(qū)動(dòng)器采用低電壓的設(shè)計(jì),可以支持低至只有幾百 mV 的核心干線電壓 。此外,電流會(huì)經(jīng)過(guò) MPL 接地(MG)直接回流 。以驅(qū)動(dòng)器的設(shè)計(jì)來(lái)說(shuō),MC(時(shí)鐘)輸出與 MD(數(shù)據(jù))輸出實(shí)際相同 。
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